JEDEC JESD8-15A-2003 标准详情
- 标准号：JEDEC JESD8-15A-2003
- 中文标题：1.8V的短系列终止逻辑(SSTL-3)(SSTL－18)
- 英文标题：stub series terminated logic for 1.8 v (sstl_18)
- 标准类别：电子元件工业联合会标准JEDEC
- 发布日期：2003-09-01
JEDEC JESD8-15A-2003 1.8V的短系列终止逻辑(SSTL-3)(SSTL－18)
内容简介
This standard defines the input, output specifications and ac test conditions for devices that aredesigned to operate in the SSTL_18 logic switching range, nominally 0 V to 1.8 V. The standard maybe applied to ICs operating with separate VDD and VDDQ
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